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LTC4216
16
4216fa
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applicaTions inForMaTion
Figure 9. Normal Power-Up Sequence (with Analog Current Limiting)
SENSEP
ON
TIMER
SS
GATE
V
OUT
I
LOAD
FILTER
RESET
V
CC
POWER GOOD
V
FB
 > 0.6V
LOAD CURRENT REGULATING
AT 40mV/R
SENSE
POWER BAD
V
FB
 < 0.6V
(V
GATE
  V
OUT
) > V
GS(TH)
(V
SENSEP
  V
SENSEN
) > 25mV
FILTER RAMPS UP WHEN (V
SENSEP
  V
SENSEN
) > 25mV
OUTPUT IN ANALOG CURRENT LIMIT,
(V
SENSEP
  V
SENSEN
) = 40mV
(V
SENSEP
  V
SENSEN
) < 25mV
TRACKS SS RAMP
IN REGULATION
20礎
60礎
2.4礎
V
TMR(TH)
2礎
V
TMR(TH)
2礎
10礎
10礎
1礎
CHECK FOR GATE,
FILTER, TIMER,
SS < 0.2V
 CHECK FOR GATE, FILTER, TIMER, SS < 0.2V AND FAULT HIGH
PLUG-IN CYCLE
FIRST TIMING CYCLE
POWER-GOOD DELAY
SECOND TIMING CYCLE
4216 F09
1 2
3   4
5  6   7  8   9 10 11
12
16
15
14
13
0.72V
0.4V
0.8V
ELECTRONIC CIRCUIT BREAKER ARMED
RESET
GOES HIGH
IN RESET
MODE
(ON < 0.4V)
ON GOES LOW
(ON < 0.72V)
OUTPUT NO LONGER
IN CURRENT LIMIT
RESET PULLED LOW
DUE TO POWER BAD
2ND TIMING CYCLE CANNOT START WITH
OUTPUT IN ANALOG CURRENT LIMIT
V
FILT(TH)
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